P
PeterChow
Guest
Oi
Tenho um problema durante o meu processo de desing, que é sobre os pinos global Virtex2 do relógio.
Nele está o datasheet há expressões como esta:
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O principal (GCLKP) e secundário (GCLKS pastilhas) relógio não têm nenhuma relaçãocom a P-N-lado e lado das entradas de relógio diferencial.
Nos bancos 0 e 1, o GCLKPcorresponde ao lado N, e os GCLKS corresponde ao P-lado de uma entrada de clock diferenciais.
Em bancos de 4 e 5, esta correspondência é inversa.
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Agora eu devo começar a saída do relógio diferencial (sinais: lvpecl_clk_n e lvpecl_clk_p) de Virtex2, assim como devo ligar os pinos diferencial? Eu estou perplexo com as expressões.
Suponha que está na BANK0, o lvpecl_clk_n sinal diferencial deve ser GCLKP ou GCLKN?
ObrigadoAdicionado após 26 minutos:Eu estou receoso que eu cometi um erro, quando ele é usado como caminho de relógio mundial, a direção dos pinos de relógio global são input.So se eu quiser um relógio diferencial LVPECL a partir deles, podem apenas ser visto como normal IO pins.So o P-lado dos pinos deve ser ligado ao P-lateral do sinal, e assim como o N-pinos laterais e signals.It é? Obrigado.
Tenho um problema durante o meu processo de desing, que é sobre os pinos global Virtex2 do relógio.
Nele está o datasheet há expressões como esta:
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O principal (GCLKP) e secundário (GCLKS pastilhas) relógio não têm nenhuma relaçãocom a P-N-lado e lado das entradas de relógio diferencial.
Nos bancos 0 e 1, o GCLKPcorresponde ao lado N, e os GCLKS corresponde ao P-lado de uma entrada de clock diferenciais.
Em bancos de 4 e 5, esta correspondência é inversa.
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Agora eu devo começar a saída do relógio diferencial (sinais: lvpecl_clk_n e lvpecl_clk_p) de Virtex2, assim como devo ligar os pinos diferencial? Eu estou perplexo com as expressões.
Suponha que está na BANK0, o lvpecl_clk_n sinal diferencial deve ser GCLKP ou GCLKN?
ObrigadoAdicionado após 26 minutos:Eu estou receoso que eu cometi um erro, quando ele é usado como caminho de relógio mundial, a direção dos pinos de relógio global são input.So se eu quiser um relógio diferencial LVPECL a partir deles, podem apenas ser visto como normal IO pins.So o P-lado dos pinos deve ser ligado ao P-lateral do sinal, e assim como o N-pinos laterais e signals.It é? Obrigado.