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Bebo

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Oi ...
Como eu disse antes que sou um novato em Verilog e eu tenho um problema no meu código eu não sei como resolver o problema ..

meu projeto é para salvar uma imagem (142 X 185) na SRAM
então eu preciso de 18 a localização de cada pixel da imagem

Eu tentei escrever um código que incrementar o endereço de SRAM com o recebimento de bytes.
e eu quero mostrar os incrementos de endereço em que o LED
Este é o meu código:############################################

MEM_SRAM (módulo
DATA_BUS, / / Data Bus
Endereço, / / RAM Endereço
NRD, / / RAM Read Enable
NWR, / / RAM Write Enable
NCE, / / RAM Chip Enable
NUB, / / RAM Upper Byte
NLB, / / RAM byte inferior
Data_In,
LEDG,
WE); / / Write Enable

output [17:0] Endereço / / RAM Signals
inout [7:0] DATA_BUS;
saída NRD, NWR;
saída NUB, NLB;
nCE saída;
WE entrada; / / Write Enable
reg [16:0] Address_In = 17'h0;
input [7:0] Data_In;
output [17:0] LEDG;
atribuir NUB = 1'b1 / / Desativar Alto Byte
atribuir NLB = 1'b0; / / Enable byte inferior
atribuir Ñçê = 1'b0; / / Enable Chip
atribuir NRD = 1'b0; / / Read Enable
atribuir NWR =! WE; / / Write Enablealways @ (WE)
begin: SRAM_WRITE
DATA_BUS = WE?Data_In: 8'hzz;
Endereço [17:0] = Address_In 1;
LEDG = Address_In;fim

endmodule############################################

Eu encontrei esses erros:Erro (10137): Verilog HDL processuais erro na atribuição MEM_SRAM.v (39): "objeto DATA_BUS" no lado esquerdo da atribuição deve ter um tipo de dados variáveisErro (10137): Verilog HDL processuais erro na atribuição MEM_SRAM.v (40): "objeto" Endereço no lado esquerdo da atribuição deve ter um tipo de dados variáveisErro (10137): Verilog HDL processuais erro na atribuição MEM_SRAM.v (41): "objeto LEDG" no lado esquerdo da atribuição deve ter um tipo de dados variáveisPlz help me

<img src="http://www.edaboard.com/images/smiles/icon_cry.gif" alt="Muito triste" border="0" />
 
1.atribuições dentro do bloco sempre devem ser declarados como "reg"
2.inout variáveis devem ser declaradas com instruções de atribuição contínua (atribuir)

tente este

saída reg [17:0] Endereço / / RAM Sinais / include reg
inout [7:0] DATA_BUS;

saída NRD, NWR;
saída NUB, NLB;
nCE saída;
WE entrada; / / Write Enable
reg [16:0] Address_In = 17'h0;
input [7:0] Data_In;

saída reg [17:0] LEDG; / include reg

atribuir NUB = 1'b1 / / Desativar Alto Byte
atribuir NLB = 1'b0; / / Enable byte inferior
atribuir Ñçê = 1'b0; / / Enable Chip
atribuir NRD = 1'b0; / / Read Enable
atribuir NWR =! WE; / / Write Enablealways @ (WE)
começo

Address = Address_In 1;
LEDG = Address_In;
fim

atribuir DATA_BUS = WE?Data_In: 8'hzz;

endmodule

 

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