Cadence C apresenta-a-Silicon Compiler

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Cadence Design Systems, Inc. introduziu C-à-Silicone Compiler, um produto de alto nível de síntese de apoio à criação e re-utilização de sistemas on-chip IP.A tecnologia inovadora em C-à-Silicone ajuda a ponte entre o nível de registo de transferência (RTL) modelos comumente utilizados para verificar, implementar e integrar o sistema de SoCs e modelos de nível, geralmente escrito em C / C e SystemC.
C-à-Silicone é o primeiro produto entregues a partir de uma nova iniciativa de codinome Sydney e foi desenvolvido dentro de um grupo de incubação interna dirigida por Michael McNamara, vice-presidente / diretor geral, C-à-Silicone Compiler.Os objetivos do produto são dois: a ponte entre o uso de C como uma linguagem de design e descrição RTL do projeto, e para melhorar a aplicação de silício do projeto, fornecendo uma ligação directa entre as restrições de produção e também a descrição C.http://www.edadesignline.com/showArticle.jhtml? articleID = 209000061 & cid = NL_edadl

 
Quais são as chances de o produto ser sucesso?

quaisquer actualizações sobre este assunto?

 
Se esta ferramenta é tão poderosa, vamos perder o emprego!

 
existe alguma documentação sobre isso para que possamos aprender novas e mais uma coisa como essa é tão boa em obras

 
Aqui está alguma documentação que recebi Cadence quando eu perguntei sobre o que ontem ..
Desculpe, mas você precisa de login para ver esta penhora

 
Tenho medo que os engenheiros digital vai encontrar um desafio

 
Compilador C2Silicon não pode otimizar o tamanho e potência.O melhor chip é desenvolvido pelo engenheiro melhores

 
skymusic escreveu:

Compilador C2Silicon não pode otimizar o tamanho e potência.
O melhor chip é desenvolvido pelo engenheiro melhores
 
A informação parece muito superficial.Há algum "sucesso" histórias publicadas?

 
Oi tudo,
alguém pode explicar o modo de verificação formal é realizada utilizando-C2S?
Existem algumas ferramentas de verificação formal de apoio a esse fluxo?
Thnx,
Pavlos

 

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